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【系统简介】 |
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LJ-FC100 FPGA&CPLD 开发实验平台 主要面向高等院校 电子、计算机、通信、控制等相关专业本科或研究生，相关专业的技术工程师，对 FPGA/CPLD 设计及应用有兴趣的研发人员 而推出的学习开发工具。
开发实验板采用了 ALTERA 公司的 FLEX 10K 系列 FPGA 和 XILINX 公司的 XC9500 系列 CPLD 器件作为核心芯片，可在 ALTERA 开发平台 MAX+PLUS Ⅱ或 QUARTUS Ⅱ和 XILINX 的专业平台 ISE 上进行各种功能设计和验证；开发板综合了许多外围功能器件，例如：六位七段数码管、发光二极管、高亮矩阵 LED 、无源蜂鸣器、功能按键、拨码开关、 128 x 64 点阵型和 16 x 2 行字符型液晶显示模块、 PS/2 键盘或鼠标接口、 RS232 标准接口、串行 EEPROM （ I 2 C ）等。
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| 【参考照片】 |
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| 【主要特点】 |
- 集 ALTERA 公司 FPGA 和 XILINX 公司 CPLD 于一体，使您能够在同一时间里学习并掌握到世界上两大主流公司逻辑器件的应用
- 基于 SRAM 配置型 FPGA 器件具有无限次数下载、验证特点，开发实验板采用一个 TQFP144 封装形式的 EPF10K20 芯片， 6.3 万门， 1152 个逻辑单元， 12288 位 RAM ，系统资源丰富，可以满足不同设计需要
- XC9500 系列 CPLD 芯片 具有高性能、高密度、 5V ISP 、可擦除多达 1 万次、增强型的引脚锁定功能、灵活的 36V18 功能模块、支持 JTAG 边界扫描、每个宏单元的功率可以单独配置、可驱动 24mA 输出、采用先进的 5V FastFlash 工艺等优点，开发实验板上使用的是一个 PLCC84 封装的 XC95108 ，内部有 108 个宏单元和 2400 个门电路，板上芯片 可以更换
- I/O 扩展能力强， FPGA 和 CPLD 所有用户 I/O 引脚全部引出并可以与板上资源隔离，可以直接应用到 5V 和 3.3V 系统
- 提供完整、详细开发文档、实用的开发实例和源程序
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| 【配套软件】 |
- Altera Quartus II 5.0
- Xilinx ISE 6.2
- 相关调试及工具软件
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| 【演示程序】 |
- FPGA 实现计数器分频显示例程
- FPGA 实现电子钟例程
- FPGA 实现点阵型 LCD 模块显示汉字例程
- FPGA 实现开发板与 PC 机串口通迅例程
- FPGA 结合串口进行串行 EEPROM 读写例程
- CPLD 实现字符型 LCD 显示例程
- CPLD 实现计数器分频显示例程
- CPLD 实现矩阵 LED 显示例程
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| 【设计文档】 |
- 开发板用户手册
- 开发板原理图( pdf格式 )
- 开发板所用全部 IC 资料
- Quartus II 使用指南
- Xilinx ISE 使用指南
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| 【产品清单】 |
LJ-FC100 FPGA&CPLD 开发实验套件
序号 |
名 称 |
单位 |
数量 |
1 |
LJ-FC100 FPGA&CPLD 开发实验板 |
块 |
1 |
2 |
16 x 2 行字符型液晶模块 |
块 |
1 |
3 |
128 x 64 点阵型液晶模块 |
块 |
1 |
4 |
ByteBlasterMV TM 下载线 |
条 |
1 |
5 |
XILINX 并口标准下载线 |
条 |
1 |
6 |
5V 开关电源 |
个 |
2 |
7 |
串口延长线 |
条 |
1 |
8 |
光盘（ Quartus II 和 ISE 软件、文档及实例程序） |
片 |
3 |
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| 【资料下载】 |
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